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基于SoC的千兆EPON ONU硬件平臺
言之onu為用戶提供epon的接人功能。根據(jù)ieee802.3ah標(biāo)準[3].onu作為epon系統(tǒng)的用戶端接入設(shè)備,主要完成的功能可描述為： ◆選擇接收olt發(fā)送的廣播數(shù)據(jù)： ◆響應(yīng)olt發(fā)出的注冊和測距命令： ◆對用戶的以太網(wǎng)數(shù)據(jù)進行緩存,向olt報告緩存的隊列情況并在olt分配的上行發(fā)送窗口中發(fā)送緩存的數(shù)據(jù)： ◆根據(jù)olt發(fā)出的oam幀，執(zhí)行相應(yīng)的oam功能： ◆其它相關(guān)的以太網(wǎng)功能。 3 fpga邏輯結(jié)構(gòu)簡介由于處于asic設(shè)計的前端，采用altera公司的fpga ep2c70f672c6作為核心處理單元，并基于這塊fpga進行邏輯代碼的編寫、測試和驗證。 epon onu mac控制芯片內(nèi)部邏輯設(shè)計如圖1所示，整個系統(tǒng)可以分為上行和下行兩部分，下行是數(shù)據(jù)從olt傳輸?shù)給nu，上行是數(shù)據(jù)從onu傳輸?shù)給lt。接收模塊對下行數(shù)據(jù)進行10位轉(zhuǎn)8位碼變換,llid的濾除和幀校驗,然后進行幀分類。在下行鏈路中,除了有用戶數(shù)據(jù)外,還有mpcp和oam幀，幀分類模塊把接收模塊處理后的數(shù)據(jù)按類別交給對應(yīng)模塊。同樣上行鏈路中除了用戶數(shù)據(jù)外，還有register ack幀、register re
基于FPGA和DSP的1394b雙向數(shù)據(jù)傳輸系統(tǒng)
統(tǒng)帶來諸多問題。因此這里采用pci9054總線接口芯片配合fpga和dsp來實現(xiàn)1394b雙向數(shù)據(jù)傳輸系統(tǒng)，將對復(fù)雜的pci總線接口的控制轉(zhuǎn)換為對相對簡單的本地總線接口的控制，不僅對pci協(xié)議有著良好的支持，而且提供給設(shè)計者良好的接口，大大減少了設(shè)計者的工作量。pci9054芯片在pci總線端支持32位/33 mhz,當(dāng)本地總線端采用32位數(shù)據(jù)總線時，其數(shù)據(jù)傳輸速率可達132 mb/s,故能夠滿足1394b總線上800 mb/s的數(shù)據(jù)傳輸速率要求。本設(shè)計中的主控芯片采用altera公司的ep2c70f672c6型fpga主流芯片，dsp選用ti公司的tms320c6415 dsp芯片，1394b套片選用ti公司的鏈路層芯片tsb82aa2和物理層芯片tsb81ba3,pci9054采用plx公司的32位33mhz的pci總線通用接口芯片。1394b雙向數(shù)據(jù)傳輸系統(tǒng)的硬件總體結(jié)構(gòu)圖如圖1所示，主要由現(xiàn)場可編程門陣列（fpga）模塊、dsp模塊、ad/da數(shù)據(jù)轉(zhuǎn)換接口模塊、spi數(shù)據(jù)輸入/輸出接口模塊、串口（uart）通信模塊、sram存儲模塊、epcs串行配置器件模塊、flash存儲模塊、pci9054

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