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嚴選現貨
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7185
MICRON
TSOP/1652+
進口原裝現貨

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基于FPGA的LVDS高速數據通信卡設計
生震蕩；fpga接收端在差分線間并接一個100 ω的終端電阻，電流主要通過終端電阻形成回路，從而在接收器的輸入端形成差分接收的信號電壓；pcb布線時防止lvds高速信號串擾和互擾，避免其他信號耦合到lvds傳輸線上，應盡量將lvds信號和其他信號分別布在兩個信號層上。圖2 lvds發(fā)送和接收接口電路 1.3 其他接口設計為滿足pci總線的dma傳輸特性，需要在硬件上加入緩沖區(qū)。輸入的lvds速率越高，需要的緩沖區(qū)容量越大，以保證不丟失數據。因此設計選用micron公司提供的mt48lc2m32 sdram作為緩沖區(qū)，它是一款64 mb全同步sdram.另外，輸出的lvds信號要求10~50 mhz頻率范圍內任意可調，因此選用ad公司采用cmos技術生產的直接數字合成器ad9851,它的最高工作時鐘為180 mhz,內部除了完整的高速dds外，還集成了時鐘6倍頻器和一個高速比較器，并且它的接口控制簡單，可以用8位并行口或串行口直接輸入頻率、相位等控制數據。設計中通過fpga中pll輸出30 mhz時鐘，倍頻器將參考時鐘倍頻至180 mhz,控制接口采用并行口傳輸。除此之外，時鐘

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