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LF247 WIDE BANDWIDTH QUAD J-FET OPERATIONA... STMICROELECTRONICS LF247PDF下載
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lf247中文資料

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基于FPGA的雙備份多路數(shù)據(jù)采集存儲系統(tǒng)的設計與實現(xiàn)
。 3系統(tǒng)軟件設計 3.1采集控制邏輯的設計對于多通道異步時分采集這種形式的電路，由于在電子開關切換的過程中存在著串擾，信號受到該串擾后，濾波放大器的輸出在adc采樣前未穩(wěn)定至其應有的精度，就會對adc的采樣有影響，從而影響采集精度。所以，為了解決串擾問題，只有在實踐的基礎上，靠經(jīng)驗去選擇合適的運放，或者是通過硬件與系統(tǒng)軟件優(yōu)化相結合的方法尋找解決途徑。在確保系統(tǒng)采樣率的前提下，本設計通過硬件與軟件相結合的方法來解決串擾問題。硬件上采集模塊選擇sr（壓擺率）較高的運放lf247作為濾波跟隨器，軟件上則以并行的工作方式確保采樣前采樣通道信號的穩(wěn)定，即在時序設計上，主程序中采用了兩個進程：（1）完成數(shù)據(jù)的轉換、幀計數(shù)和數(shù)據(jù)的傳輸；（2）根據(jù)幀計數(shù)frame_cnt控制通道地址信號a和p進行通道切換。這兩個進程并行執(zhí)行。 fpga采集控制邏輯流程圖如圖4所示。其中，a為通道選擇輸出，接adg506的通道選擇控制端（a3~a0）；p為adg506選通信號，接adg506的片選端（en）。由于存儲器采用雙備份設計以及對兩片存儲器的寫入操作完全相同，故采集控制