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與引腳的連接盡可能短，以降低電源線內(nèi)阻的消耗。2.6 輸入輸出電平 enc28j60是一個(gè)3.3 v的cmos器件，但它設(shè)計(jì)得非常容易統(tǒng)一到5 v系統(tǒng)中去：spi、cs、 sck、si輸入和reset引腳一樣，都可承受5 v電壓。當(dāng)spi和中斷輸入與3.3 v驅(qū)動(dòng)的cmos輸出不兼容時(shí)，可能需要一個(gè)單向的電平轉(zhuǎn)換器。74hct08 (四與門), 74act125(四三態(tài)緩沖器)和許多具有ttl電平輸入的5 v cmos緩沖器芯片都可以提供所需的電平轉(zhuǎn)換。2.7 led配置 leda和ledb引腳在復(fù)位時(shí)支持極性自動(dòng)檢測(cè)。既可直接驅(qū)動(dòng)led，又可灌電流驅(qū)動(dòng)。復(fù)位時(shí)enc28j60檢測(cè)led的連接，并按照 phlcon寄存器的默認(rèn)設(shè)置來驅(qū)動(dòng)。運(yùn)行過程中的led極性轉(zhuǎn)換直到下一次系統(tǒng)復(fù)位后才能被檢測(cè)到。ledb的連接比較特殊，在復(fù)位過程中檢測(cè)它的連接，決定如何初始化phcon1寄存器的pdpxmd位。如果ledb直接驅(qū)動(dòng)led，則phcon1.pdpxmd位被清零，phy工作在半雙工模式；如果ledb吸收反向電流點(diǎn)亮led，則phcon1.pdpxmd被置位，phy工作在全雙工模式；如果
以電源線應(yīng)盡可能寬，與引腳的連接盡可能短，以降低電源線內(nèi)阻的消耗。2.6 輸入輸出電平 enc28j60是一個(gè)3．3 v的cmos器件，但它設(shè)計(jì)得非常容易統(tǒng)一到5 v系統(tǒng)中去：spi、cs、sck，si輸入和reset引腳一樣，都可承受5v電壓。當(dāng)spi和中斷輸入與3．3v驅(qū)動(dòng)的cm0s輸出不兼容時(shí)，可能需要一個(gè)單向的電平轉(zhuǎn)換器。74hct08(四與門)，74actl25(四三態(tài)緩沖器)和許多具有ttl電平輸入的5vcmos緩沖器芯片都可以提供所需的電平轉(zhuǎn)換。2.7 led配置 leda和ledb引腳在復(fù)位時(shí)支持極性自動(dòng)檢測(cè)。既可直接驅(qū)動(dòng)led，又可灌電流驅(qū)動(dòng)。復(fù)位時(shí)enc28j60檢測(cè)led的連接，并按照phlcon寄存器的默認(rèn)設(shè)置來驅(qū)動(dòng)。運(yùn)行過程中的led極性轉(zhuǎn)換直到下一次系統(tǒng)復(fù)位后才能被榆測(cè)到。ledb的連接比較特殊，在復(fù)位過程中檢測(cè)它的連接，決定如何初始化phconl寄存器的pdpxmd位。如果ledb直接驅(qū)動(dòng)led，則phcon1.pdpxmd位被清零，phy工作在半雙工模式；如果ledb吸收反向電流點(diǎn)亮led，則phcon1．pdpxmd被置位，phy工作在全雙工模式；如果l
2 enc28j60 網(wǎng)絡(luò)接口體系結(jié)構(gòu) enc28j60 是帶有行業(yè)標(biāo)準(zhǔn)串行外設(shè)接口（serial peripheralinterface, spi）的獨(dú)立以太網(wǎng)控制器。它符合ieee 802.3 的全部規(guī)范， 采用了一系列包過濾機(jī)制以對(duì)傳入數(shù)據(jù)包進(jìn)行限制。它還提供了一個(gè)內(nèi)部dma 模塊， 以實(shí)現(xiàn)快速數(shù)據(jù)吞吐和硬件支持的ip 校驗(yàn)和計(jì)算。與主控制器的通信通過兩個(gè)中斷引腳（int和wol）和spi 腳（so、si、sck、cs）實(shí)現(xiàn)， 數(shù)據(jù)傳輸速率高達(dá)10mb/s.兩個(gè)專用的引腳（leda、ledb）用于連接led, 進(jìn)行網(wǎng)絡(luò)活動(dòng)狀態(tài)指示。圖1 所示為enc28j60 的典型應(yīng)用電路。 enc28j60 由7 個(gè)主要功能模塊組成：spi 接口， 充當(dāng)主控制器和enc28j60 之間通信通道； 控制寄存器， 用于控制和監(jiān)視enc28j60; 雙端口ram緩沖器， 用于接收和發(fā)送數(shù)據(jù)包； 判優(yōu)器， 當(dāng)dma、發(fā)送和接收模塊發(fā)出請(qǐng)求時(shí)對(duì)ram緩沖器的訪問進(jìn)行控制； 總線接口， 對(duì)通過spi 接收的數(shù)據(jù)和命令進(jìn)行解析；mac 模塊：實(shí)現(xiàn)符合ieee 802.3 標(biāo)準(zhǔn)的mac 邏輯； ph
●pwmr、pwmb、pwmg （j8的引腳1、3和4）：rgb pwm輸入信號(hào)，幅值應(yīng)為3.3v至5v。當(dāng)輸出的上升/下降時(shí)間保持在1?s以內(nèi)時(shí)，任何超出2?s的pwm周期均可使用。某一時(shí)刻只有上述三個(gè)信號(hào)之一為高電平。 ●pwmn （j8的引腳4）：pwmr、pwmg和pwmb進(jìn)行邏輯nor。只有所有三個(gè)pwm信號(hào)均為低電平時(shí)，pwmn為高電平。 ●on/off （j1）：保持開路或驅(qū)動(dòng)至+5v使能驅(qū)動(dòng)器，連接至gnd禁用電路板工作。 輸出 ●ledr、ledg、ledb （j5、j6和j7）：10a rgb led輸出。將led+連接至引腳3、4和5；將led-連接至引腳6、7和8。 ●outv （j2）：提供與led電流成比例的信號(hào)，outv上的電壓為r12||r16電壓的135倍。 ●vin_out （j3）：輸入電源電壓，用于連接至其它電路板。引腳1和2為vin+；引腳3和4為gnd。 圖1. led驅(qū)動(dòng)電路板（頂層） 圖2. led驅(qū)動(dòng)電路板（底層） 圖3. 由max16821構(gòu)成的led驅(qū)動(dòng)器原理圖。 電路說明
根據(jù)系統(tǒng)設(shè)計(jì)要求可知，系統(tǒng)的輸入信號(hào)有：各組的搶答按鈕a、b、c、d，系統(tǒng)清零信號(hào)clr，系統(tǒng)時(shí)鐘信號(hào)clk，計(jì)分復(fù)位端rst，加分按鈕 端add，計(jì)時(shí)預(yù)置控制端ldn，計(jì)時(shí)使能端en，計(jì)時(shí)預(yù)置數(shù)據(jù)調(diào)整按鈕ta、tb；系統(tǒng)的輸出信號(hào)有：四個(gè)組搶答成功與否的指示燈控制信號(hào)輸出 口leda、ledb、ledc、ledd，四個(gè)組搶答時(shí)的計(jì)時(shí)數(shù)碼顯示控制信號(hào)若干，搶答成功組別顯示的控制信號(hào)若干，各組計(jì)分動(dòng)態(tài)顯示的控制信號(hào) 若干。本系統(tǒng)應(yīng)具有的功能有：第一搶答信號(hào)的鑒別和鎖存功能；搶答計(jì)時(shí)功能；各組得分的累加和動(dòng)態(tài)顯示功能；搶答犯規(guī)記錄功能。 根據(jù)以上的分析，我們可將整個(gè)系統(tǒng)分為三個(gè)主要模塊：搶答鑒別模塊qdjb；搶答計(jì)時(shí)模塊jsq；搶答計(jì)分模塊jfq。對(duì)于需顯示的信息，需增 加或外接譯碼器，進(jìn)行顯示譯碼?？紤]到fpga/cpld的可用接口及一般h）a實(shí)驗(yàn)開發(fā)系統(tǒng)提供的輸出顯示資源的限制，這里我們將組別顯示和計(jì) 時(shí)顯示的譯碼器內(nèi)設(shè)，而將各組的計(jì)分顯示的譯碼器外接。整個(gè)系統(tǒng)的組成框圖如圖所示。 如圖 智力搶答器的組成框圖 系統(tǒng)的工作原理如下：當(dāng)主持人按下使能端en時(shí)，搶答器開始工
盡可能短，以降低電源線內(nèi)阻的消耗。 2.6 輸入輸出電平 enc28j60是一個(gè)3.3 v的cmos器件，但它設(shè)計(jì)得非常容易統(tǒng)一到5 v系統(tǒng)中去：spi、cs、 sck、si輸入和reset引腳一樣，都可承受5 v電壓。當(dāng)spi和中斷輸入與3.3 v驅(qū)動(dòng)的cmos輸出不兼容時(shí)，可能需要一個(gè)單向的電平轉(zhuǎn)換器。74hct08 (四與門), 74act125(四三態(tài)緩沖器)和許多具有ttl電平輸入的5 v cmos緩沖器芯片都可以提供所需的電平轉(zhuǎn)換。 2.7 led配置 leda和ledb引腳在復(fù)位時(shí)支持極性自動(dòng)檢測(cè)。既可直接驅(qū)動(dòng)led，又可灌電流驅(qū)動(dòng)。復(fù)位時(shí)enc28j60檢測(cè)led的連接，并按照phlcon寄存器的默認(rèn)設(shè)置來驅(qū)動(dòng)。運(yùn)行過程中的led極性轉(zhuǎn)換直到下一次系統(tǒng)復(fù)位后才能被檢測(cè)到。ledb的連接比較特殊，在復(fù)位過程中檢測(cè)它的連接，決定如何初始化phcon1寄存器的pdpxmd位。如果ledb直接驅(qū)動(dòng)led，則phcon1.pdpxmd位被清零，phy工作在半雙工模式；如果ledb吸收反向電流點(diǎn)亮led，則phcon1.pdpxmd被置位，phy工作在全雙工模式；如果l
出，以及設(shè)定led手電筒(或影片模式)或全閃光燈操作。它內(nèi)置的電流控制設(shè)定達(dá)6比特，提供1.5毫安led電流分辨率，電流量由0.5毫安至96毫安。單電路led設(shè)定/控制界面對(duì)于折迭式手機(jī)非常實(shí)用，因?yàn)樗鼈兊母唠娏縧ed及l(fā)ed驅(qū)動(dòng)器在折迭樞紐的相反面。 lds8621的設(shè)計(jì)參數(shù)基本上與lds8620相同，不同之處是其輸出設(shè)定及l(fā)ed電流由雙電路、雙功能邏輯界面控制。它的界面可提供ic控制及pwm模式閃光燈led光度調(diào)控。其pwm1輸入接口負(fù)責(zé)控制leda輸出操作，而pwm2輸入接口負(fù)責(zé)控制ledb輸出操作。pwm1及pwm2的輸入信號(hào)可各自獨(dú)立控制，或是互連后以應(yīng)用/基頻處理器的gpio界面驅(qū)動(dòng)。
及設(shè)定led手電筒(或影片模式)或全閃光燈操作。它內(nèi)置的電流控制設(shè)定達(dá)6比特，提供1.5毫安led電流分辨率，電流量由0.5毫安至96毫安。單電路led設(shè)定/控制界面對(duì)于折迭式手機(jī)非常實(shí)用，因?yàn)樗鼈兊母唠娏縧ed及l(fā)ed驅(qū)動(dòng)器在折迭樞紐的相反面。 lds8621的設(shè)計(jì)參數(shù)基本上與lds8620相同，不同之處是其輸出設(shè)定及l(fā)ed電流由雙電路、雙功能邏輯界面控制。它的界面可提供ic控制及pwm模式閃光燈led光度調(diào)控。其pwm1輸入接口負(fù)責(zé)控制leda輸出操作，而pwm2輸入接口負(fù)責(zé)控制ledb輸出操作。pwm1及pwm2的輸入信號(hào)可各自獨(dú)立控制，或是互連后以應(yīng)用/基頻處理器的gpio界面驅(qū)動(dòng)。
小菜鳥觀點(diǎn)是不是用數(shù)字電路就可以實(shí)現(xiàn)（p3。3外加一個(gè)非門接ledb不就行了）
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