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當(dāng)前位置:維庫電子市場網(wǎng)>IC>19.2m 更新時(shí)間:2026-04-13 02:06:25

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  • 基于FPGA的微應(yīng)變數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

    要采樣的通道個(gè)數(shù),采樣的起 始通道。 (4) 控制ad 和控制da 模塊 此模塊控制 ad 和da 芯片,產(chǎn)生使ad 和da 芯片工作的控制信號(hào)和時(shí)序邏輯。由于 需要采樣的通道數(shù)多,達(dá)25 個(gè),為節(jié)省印制電路板面積和成本,采用單片ad 芯片加多路 模擬開關(guān)進(jìn)行模擬數(shù)字量的轉(zhuǎn)換。ad 芯片tlc2551,是ti(texas instrument)公司生產(chǎn)的 精度為12 位的,單通道采樣、低功耗芯片。其工作時(shí)序如圖4 所示。時(shí)鐘信號(hào)sclk、控 制信號(hào)cs 都由fpga 產(chǎn)生,時(shí)鐘主頻為19.2m,采樣一次需要44 個(gè)時(shí)鐘周期[5]。 da 芯片采用ti 公司生產(chǎn)的tlv5*,它是一個(gè)帶參考電壓源的8 位dac,數(shù)字接口為spi 接口。fpga 控制da 芯片,使dac 的輸出與adc 輸入模擬電壓相加,抵消輸入的 零點(diǎn),產(chǎn)生0-4.096v 有效輸出送到adc 輸入端進(jìn)行轉(zhuǎn)換。tlv5* 的工作時(shí)序如圖5 所示。 時(shí)鐘信號(hào)sclk 和控制信號(hào)cs,信號(hào)fs 由fpga 產(chǎn)生,每次轉(zhuǎn)換需要16 個(gè)時(shí)鐘周期。 (5) 數(shù)據(jù)處理模塊 由adc 芯片輸出的12 位串行

19.2m替代型號(hào)

18V01 18PF 18MHZ 18LF452 18F452 18F2520 18CV8PC-25 18CV8 18B20 18AH

19.2MHZ 19.44 19.440MHZ 19.44MHZ 19.5MHZ 19.6608MHZ 19.68MHZ 19.8MHZ 1900M 190A

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