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基于FPGA的1553B總線接口板設(shè)計(jì)
把電平轉(zhuǎn)化后1553b差分信號(hào)轉(zhuǎn)化為可識(shí)別的ttl電平。但此時(shí)的信號(hào)仍然是曼徹斯特ⅱ型碼，故需經(jīng)解碼和串并轉(zhuǎn)換，同時(shí)完成數(shù)據(jù)字的同步、數(shù)據(jù)、曼徹斯特碼錯(cuò)誤的檢出、奇偶檢測和位/ 字計(jì)數(shù)等，處理后的數(shù)據(jù)串并轉(zhuǎn)換后存入內(nèi)存再對(duì)其進(jìn)行相關(guān)的協(xié)議處理。發(fā)送數(shù)據(jù)時(shí)，將終端接收的數(shù)據(jù)暫存于內(nèi)存中，等待發(fā)送命令。一旦收到發(fā)送命令，即發(fā)送數(shù)據(jù)并通過并串轉(zhuǎn)換后進(jìn)行曼徹斯特編碼且調(diào)制解調(diào)后發(fā)送到1553b的雙余度總線上。 2 系統(tǒng)硬件構(gòu)成及其實(shí)現(xiàn) 信號(hào)調(diào)制解調(diào)用隔離變壓器和收發(fā)器，分別采用的是holt公司pm-db2725ex和hi-1570芯片。而從曼徹斯特編解碼后的部分都可在一片fpga芯片內(nèi)實(shí)現(xiàn)，選定altera公司cyclone系列的ep1c12作為主芯片。其中fpga與總線間接口部分的電路如圖2。 fpga與總線間接口部分的電路 3 fpga內(nèi)部的模塊構(gòu)成及實(shí)現(xiàn) fpga片內(nèi)的實(shí)現(xiàn)，通過verilog程序和調(diào)用quartusii軟件內(nèi)部宏模塊完成，可分為雙冗余曼徹斯特ii編解碼及串并轉(zhuǎn)換、總線傳輸邏輯、終端協(xié)議和消息處理、內(nèi)存及控制器和子系統(tǒng)等模塊。 3.1 雙冗余曼徹斯特ii編解

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