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#。在max 1446完成一個a/d轉(zhuǎn)換后,使目標設(shè)備準備好信號lrdyi#有效,表明數(shù)據(jù)已經(jīng)在數(shù)據(jù)線上,通知主設(shè)備可以從數(shù)據(jù)線上讀取數(shù)據(jù)了。由于max 1446的數(shù)據(jù)轉(zhuǎn)換時間需要5.5個時鐘周期,因此采用一個模6計數(shù)器作為控制電路,以保證在數(shù)據(jù)轉(zhuǎn)換完成后,才產(chǎn)生lrdyi#。數(shù)據(jù)采集卡原理圖數(shù)據(jù)采集卡原理圖如圖2所示。對原理圖有以下幾點說明。 (1)設(shè)計中采用9052的非復(fù)用模式,因此將mode接地,所以9052的lad[31..0]上只有數(shù)據(jù)信息,而其地址信息在la[27..0]上,又由于max1446的轉(zhuǎn)換位數(shù)為10bit,因此將該10位輸出數(shù)據(jù)d[9..0]連接到pci 9052的lad[9..0],而lad[31..10]接地。(2)a/d變換器max 1446的時鐘頻率可高達60mhz。在設(shè)計中將pci總線時鐘(33mhz)作為a/d的時鐘信號,從而簡化了a/d的時鐘電路。為了保證lrdyi#信號的產(chǎn)生同max 1446的轉(zhuǎn)換同步,模6計數(shù)器的時鐘信號也采用pci總線的時鐘信號。(3)數(shù)據(jù)采集的速率的控制是通過上層的軟件完成的。在設(shè)計中,將pci 9052的局部總線端的輸出信號cs0#
446完成一個a/d轉(zhuǎn)換后,使目標設(shè)備準備好信號lrdyi#有效,表明數(shù)據(jù)已經(jīng)在數(shù)據(jù)線上,通知主設(shè)備可以從數(shù)據(jù)線上讀取數(shù)據(jù)了。 由于max 1446的數(shù)據(jù)轉(zhuǎn)換時間需要5.5個時鐘周期,因此采用一個模6計數(shù)器作為控制電路,以保證在數(shù)據(jù)轉(zhuǎn)換完成后,才產(chǎn)生lrdyi#。 數(shù)據(jù)采集卡原理圖 數(shù)據(jù)采集卡原理圖如圖2所示。 對原理圖有以下幾點說明。 (1)設(shè)計中采用9052的非復(fù)用模式,因此將mode接地,所以9052的lad[31..0]上只有數(shù)據(jù)信息,而其地址信息在la[27..0]上,又由于max1446的轉(zhuǎn)換位數(shù)為10bit,因此將該10位輸出數(shù)據(jù)d[9..0]連接到pci 9052的lad[9..0],而lad[31..10]接地。 (2)a/d變換器max 1446的時鐘頻率可高達60mhz。在設(shè)計中將pci總線時鐘(33mhz)作為a/d的時鐘信號,從而簡化了a/d的時鐘電路。為了保證lrdyi#信號的產(chǎn)生同max 1446的轉(zhuǎn)換同步,模6計數(shù)器的時鐘信號也采用pci總線的時鐘信號。 (3)數(shù)據(jù)采集的速率的控制是通過上層的軟件完成的。在設(shè)計中,將pci 9052的局部總線端的輸出信號