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當前位置：維庫電子市場網(wǎng)>IC>d350 更新時間:2026-04-13 01:36:42

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  • PCB設(shè)計/ 制造數(shù)據(jù)交換技術(shù)及標準化

    - 352 標準；⑥idf 2. 0 和idf 3. 0 格式———ipc - d - 356 ，ipc - d- 355 標準；⑦incases 格式(sultan) ———iec 1182- 10 標準。 pcb數(shù)據(jù)交換技術(shù)及標準化 當前，在eda 軟件、cam 設(shè)備經(jīng)歷巨大變革的同時，有專家稱，在pcb 產(chǎn)品數(shù)據(jù)交換領(lǐng)域的進展已滯后了20 多年，數(shù)據(jù)交換欠缺標準化間接導(dǎo)致了設(shè)計/ 制造的成本上升。 改變pcb數(shù)據(jù)交換模式的迫切性 現(xiàn)有的pcb 數(shù)據(jù)標準，例如ipc d350 ，普遍傾向于在兩個特定對象(設(shè)計工具和設(shè)計工具、設(shè)計工具和制造應(yīng)用) 之間做點對點的交換。圖1 可形象化地說明這種混亂局面。其中， t 代表不同的工具，d 代表不同的pcb 數(shù)據(jù)結(jié)構(gòu)， a 代表不同的應(yīng)用，雙線箭頭表示點對點的pcb 數(shù)據(jù)交換。eda 工具輸出和制造應(yīng)用之間多對多的映射關(guān)系，是亂象的根源。 圖1 設(shè)計工具與制造應(yīng)用之間點對點的交換 在eda 工具t 的輸出端和制造應(yīng)用設(shè)備a 的輸入端，如果用于交換的只有單一的pcb 數(shù)據(jù)格式標準d ，則將大大簡化pcb 的信

  • 基于FPGA的IRIG-B編碼器的設(shè)計

    下第二個脈沖)為從ppm12信號中恢復(fù)的每秒脈沖數(shù)信號；通道4(最下面的波形)為irlg-b編碼的交流輸出波形。圖5中示波器的觸發(fā)點即為b碼參考點pr。 4.3 irig-b編碼輸出 4.3.1 直流碼輸出 為了保證輸出信號的邊沿和抗干擾，將第4.1節(jié)得到的ttl電平b碼信號和秒脈沖經(jīng)高速光耦隔離，輸出電路如圖6所示。 圖6中，輸入信號irig_b為第4.1節(jié)所述fpga編碼模塊輸出的直流編碼信號；pps為fpga從m12t的100 pps信號中恢復(fù)的秒脈沖信號；d350和d351實現(xiàn)了ttl／rs485的電平轉(zhuǎn)換。 4.3.2 模擬調(diào)制電壓輸出 irig-b編碼的交流碼輸出電路如圖6所示。將第4.2.3節(jié)所述數(shù)字調(diào)制信號通過dac接口輸出到max5712上進行d／a轉(zhuǎn)換，經(jīng)過ad8601濾除高次諧波后，再用電容耦合到由晶體管q301構(gòu)成的電壓放大器中，然后經(jīng)600：600的隔離變壓器輸出。 5 結(jié) 語 利用fpga和m12t授時型gps內(nèi)核構(gòu)成的irig-b編碼模塊采用m12t的100 pps信號觸發(fā)irig-b編碼器，使得編碼輸出的

  • 組合GPS引擎和FPGA的IRIG-B編碼器實現(xiàn)

    上至下第二個脈沖）為從ppm12信號中恢復(fù)的每秒脈沖數(shù)信號；通道4（最下面的波形）為irig-b編碼的交流輸出波形。圖5中示波器的觸發(fā)點即為b碼參考點pr。 4.3 irig-b編碼輸出 4.3.1 直流碼輸出 為了保證輸出信號的邊沿和抗干擾，將第4.1節(jié)得到的ttl電平b碼信號和秒脈沖經(jīng)高速光耦隔離，輸出電路如圖6所示。 圖6中，輸入信號irig-b為第4．1節(jié)所述fpga編碼模塊輸出的直流編碼信號；pps為fpga從m12t的100 pps信號中恢復(fù)的秒脈沖信號；d350和d351實現(xiàn)了ttl／rs485的電平轉(zhuǎn)換。 4．3．2 模擬調(diào)制電壓輸出 irig-b編碼的交流碼輸出電路如圖6所示。將第4．2．3節(jié)所述數(shù)字調(diào)制信號通過dac接口輸出到max5712上進行d／a轉(zhuǎn)換，經(jīng)過ad8601濾除高次諧波后，再用電容耦合到由晶體管q301構(gòu)成的電壓放大器中，然后經(jīng)600∶600的隔離變壓器輸出。 5 結(jié) 語 利用fpga和m12t授時型gps內(nèi)核構(gòu)成的irig-b編碼模塊采用m12t的100 pps信號觸發(fā)irig-b編碼器，使得編碼輸出的每個碼元上

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