七位并行串行碼轉換電路原理
出處：weijq 發(fā)布于：2011-08-28 21:56:52 | 2266 次閱讀
如圖所示，IC（555）和R:、RPl、C1組成無租態(tài)多諧振蕩器，產生f=1.44/（R1十RPl）Cl的脈沖，作為時鐘加至IC2和IC3-2的CL端。IC3是雙D觸發(fā)器74LS74,加進的啟動脈沖使IC3-1的Q變?yōu)榈碗娖?，使IC2移位寄存器的LD也為低電平，將并行碼D.~D6寄存在其內的寄存器Q.~Q6.隨著IC1的移人時鐘，將寄存的碼依次移人Q7,并移出IC3-2的輸出端Q。
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