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依據(jù)74HC165的級聯(lián)電路圖

出處:mochaowu03 發(fā)布于:2011-08-24 09:19:22 | 10365 次閱讀

依據(jù)74HC165的級聯(lián)電路圖

  74HC165是一款高速CMOS器件,74HC165遵循JEDEC標(biāo)準(zhǔn)no.7A。74HC165引腳兼容低功耗肖特基TTL(LSTTL)系列。
  74HC165是8位并行讀取或串行輸入移位寄存器,可在末級得到互斥的串行輸出(Q7和Q7),當(dāng)并行讀取(PL)輸入為低時,從D0到D7口輸入的并行數(shù)據(jù)將被異步地讀取進寄存器內(nèi)。
  而當(dāng)PL為高時,數(shù)據(jù)將從DS輸入端串行進入寄存器,在每個時鐘脈沖的上升沿向右移動一位(Q0 → Q1 → Q2,等等)。利用這種特性,只要把Q7輸出綁定到下的DS輸入,即可實現(xiàn)并轉(zhuǎn)串?dāng)U展。
  74HC165的時鐘輸入是一個“門控或”結(jié)構(gòu),允許其中一個輸入端作為低有效時鐘使能(CE)輸入。CP和CE的引腳分配是獨立的并且在必要時,為了布線的方便可以互換。只有在CP為高時,才允許CE由低轉(zhuǎn)高。在PL上升沿來臨之前,不論是CP還是CE,都應(yīng)當(dāng)置高,以防止數(shù)據(jù)在PL的活動狀態(tài)發(fā)生位移。



  
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