MUX-DAC1時鐘邏輯電路操作的時序電路圖

出處：lhkjg 發(fā)布于：2010-02-11 00:00:00 | 3323 次閱讀

　　使用這種方法時，觸發(fā)器要在時鐘的下降沿進行狀態(tài)更新，以消除DAC時鐘信號的毛刺，兩個MUX-DAC的輸入時序要相同。

　　布線時要考慮延遲以確保滿足兩個觸發(fā)器的建立和保持時間的要求，且在時鐘為低時將SPB信號的脈沖應用于G1。否則，時鐘信號可能會產(chǎn)生毛刺。同時建議使用無噪聲電源為時鐘同步電路供電，將抖動的引入減到最小。

所示邏輯電路操作的時序電路圖

　　圖：所示邏輯電路操作的時序圖

　　

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