Cadence為IP創(chuàng)建和復(fù)用提供高效率解決方案
出處：cxx_will 發(fā)布于：2008-08-25 13:50:27
Cadence稱，其日前推出的C-to-Silicon Compiler高階綜合產(chǎn)品，能夠讓設(shè)計(jì)師在創(chuàng)建和復(fù)用系統(tǒng)級(jí)芯片IP的過程中，將生產(chǎn)力提高10倍。C-to-Silicon Compiler中的創(chuàng)新技術(shù)成為溝通系統(tǒng)級(jí)模型之間的橋梁，它們通常是用C/C++ 和SystemC寫成的，而寄存器傳輸級(jí)（RTL）模型通常被用于檢驗(yàn)、實(shí)現(xiàn)和集成SoC。這種重要的新功能對(duì)于開發(fā)新型SoC和系統(tǒng)級(jí)IP，特別適用于消費(fèi)電子、無線和有線網(wǎng)絡(luò)市場(chǎng)。
C-to-Silicon Compiler可自動(dòng)轉(zhuǎn)化和優(yōu)化從C/C++和SystemC到可綜合的Verilog RTL (包含斷言)所描述的提取行為，進(jìn)行實(shí)現(xiàn)、驗(yàn)證和SoC集成，從而使硬件微架構(gòu)的分析自動(dòng)進(jìn)行。
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