新型數(shù)字CCD相機及其圖像數(shù)據(jù)傳輸卡設計
出處：DONG1035 發(fā)布于：2007-04-09 15:01:35
用戶總線接口信號包括： %26;#183;ＥＸＳＹＮＣ觸發(fā)幀讀出信號，是必備信號。當ＥＸＳＹＮＣ固定接低電平時，相機以幀速率輸出圖像數(shù)據(jù)；當ＥＸＳＹＮＣ正負交替時，它的下降沿觸發(fā)幀讀出。 %26;#183;ＰＲＩＮ像元復位信號，為可選信號。在兩次ＥＸＳＹＮＣ有效之間復位像元（給積累電荷的電容放電），從而縮短有效曝光時間。ＰＲＩＮ低有效，在其上升沿開始有效曝光。如果ＰＲＩＮ固定接高電平，積分時間；如果ＰＲＩＮ被固定接低電平，探測器收集不到任何圖像信息。 %26;#183;ＢＩＮ像元合并信號，也是可選信號，可以控制像元合并。像元合并后會降低相機的空間分辨率，但會增強探測器對光的敏感性。ＢＩＮ信號高有效，不用時將其接為低電平。 以上信號均由應用系統(tǒng)產(chǎn)生，送給相機，為應用系統(tǒng)根據(jù)需要設定相機的工作模式提供了手段。 數(shù)據(jù)總線接口信號為相機輸出信號，包括： %26;#183;ＤＡＴＡ０～１１１２位數(shù)據(jù)總線。ＤＡＴＡ０～１１是相機輸出的、分別對應目標某個像元灰度的１２位圖像數(shù)據(jù)。 %26;#183;ＳＴＲＯＢＥ像元時鐘信號。ＳＴＲＯＢＥ是圖像數(shù)據(jù)的像元時鐘。它的頻率與數(shù)據(jù)速率相同，即使數(shù)據(jù)無效，ＳＴＲＯＢＥ仍然連續(xù)交變。為了獲得有效的圖像數(shù)據(jù)，傳輸卡應在ＦＶＡＬ和ＬＶＡＬ為高電平時，在ＳＴＲＯＢＥ的下降沿進行數(shù)據(jù)鎖存。 %26;#183;ＦＶＡＬ幀同步信號。ＦＶＡＬ高電平表明相機正輸出一幀有效數(shù)據(jù)。 %26;#183;ＬＶＡＬ行同步信號。當ＦＶＡＬ為高電平時，ＬＶＡＬ高電平表明相機正輸出一個有效的像元行。在兩個有效行之間，ＬＶＡＬ會變低跳過幾個無效的像元，跳過的像元數(shù)取決于相機的型號和預觸發(fā)設定。 圖像數(shù)據(jù)傳輸卡正是利用這些接口信號來實現(xiàn)對相機的控制及圖像數(shù)據(jù)的抓取操作。為提高信號的抗干擾能力，所有這些接口信號均按ＲＳ４２２規(guī)范以差分方式在數(shù)字相機和圖像傳輸卡間進行傳輸，傳輸電纜為１００Ω屏蔽雙絞線。圖１表示了相機接口信號之間的時序關系。 當ＰＲＩＮ由低電平向高電平跳變時，相機開始曝光。達到設定的曝光時間后，使ＥＸＳＹＮＣ信號變低，觸發(fā)幀讀出。此時相機首先進行幀轉移，幀轉移一結束，輸出信號ＦＶＡＬ由低變高表示有效的數(shù)據(jù)幀開始，ＬＶＡＬ由低變高表示相機正輸出有效像元行。當ＦＶＡＬ和ＬＶＡＬ再變低時，表示一幀數(shù)據(jù)輸出結束，可以開始第二次觸發(fā)幀讀出（使ＥＸＳＹＮＣ有效）。第二次曝光可在次幀轉移結束后與第二次幀讀出啟動前這段時間進行，曝光時間在一定范圍內(nèi)可調。 
２ 數(shù)字ＣＣＤ相機圖像數(shù)據(jù)傳輸卡的設計實現(xiàn) 在應用系統(tǒng)中，數(shù)字ＣＣＤ相機圖像數(shù)據(jù)傳輸卡的主要任務是產(chǎn)生相機工作所需的輸入信號，解譯相機的輸出信號，使相機在電控方式下工作并實時、正確地抓取相機輸出的圖像數(shù)據(jù)，在相機和計算機內(nèi)存之間建立硬件傳輸通道。為了適應數(shù)字ＣＣＤ相機數(shù)據(jù)傳輸速率的不斷提高，早期基于ＩＳＡ總線的圖像數(shù)據(jù)傳輸卡正逐步向基于ＰＣＩ總線的傳輸卡過渡。 ２．１ 圖像數(shù)據(jù)傳輸卡電路說明 筆者設計開發(fā)的適用于ＤＡＬＳＡ公司ＣＡ－Ｄ７－１０２４Ｔ型數(shù)字ＣＣＤ相機的圖像傳輸卡的原理框圖如圖２所示。 驅動轉換接口電路對相機與傳輸卡間的接口信號進行ＲＳ４２２和ＴＴＬ電平間的相互轉換；雙口ＲＡＭ為幀存儲器，經(jīng)編程控制可將相機輸出的一幀圖像數(shù)據(jù)寫入，或經(jīng)ＰＣＩ橋讀出圖像數(shù)據(jù)至內(nèi)存。采用幀存儲器可以實現(xiàn)多個相機同時曝光，圖像數(shù)據(jù)分時通過計算機總線寫入內(nèi)存。ＦＰＧＡ時序發(fā)生器用來產(chǎn)生雙口ＲＡＭ的地址線、讀寫控制線以及相機和傳輸卡正常工作所需的聯(lián)絡信號。ＰＣＩ接口芯片是計算機與雙口ＲＡＭ及ＦＰＧＡ間的橋梁，在它們之間實現(xiàn)數(shù)據(jù)、控制信號的傳輸，并可通過初始化設置，實現(xiàn)ＰＣＩ協(xié)議提供的各種傳輸模式。 ２．２ ＦＰＧＡ時序邏輯發(fā)生器設計 本圖像數(shù)據(jù)傳輸卡采用ＡＬＴＲＡ公司生產(chǎn)的ＦＰＧＡ芯片ＥＰＭ７１２８ＳＬＣ８４－１５作為時序邏輯發(fā)生器。通過在系統(tǒng)編程（ＩＳＰ）使其實現(xiàn)一個２０位計數(shù)器、一個１位計數(shù)器、兩個鎖存器及十幾個非標邏輯門的功能。其中２０位計數(shù)器給１Ｍ%26;#215;４Ｂｉｔ的幀存儲器提供地址；１位計數(shù)器用來對卡上的３０ＭＨｚ時鐘信號進行二分頻，產(chǎn)生１５ＭＨｚ的ＶＣＬＫ信號；兩個鎖存器分別輸出行同步和場同步信號；邏輯門用來實現(xiàn)信號的與、或、非等邏輯運算。 ＡＬＴＥＲＡ公司的ＭＡＸ＋ＰＬＵＳⅡ編程仿真工具軟件，可對ＦＰＧＡ芯片進行在系統(tǒng)編程、仿真、調試，大大提高了傳輸卡設計的靈活性和對不同型號相機的適應能力，縮短了傳輸卡的研發(fā)周期。使用ＡＨＤＬ編程語言對ＦＰＧＡ芯片進行在系統(tǒng)編程，程序文件的主體如下： ＢＥＧＩＮ ＨＳＹＮＣ ＝ ｌｐｍ＿ｆｆ＿ｃｏｍｐｏｎｅｎｔ２．ｑ０．．０ ｌｐｍ＿ｆｆ＿ｃｏｍｐｏｎｅｎｔ２．ｃｌｏｃｋ ＝ ＦＶＡＬＴ＆ＳＴＲＯＢＴ＆ＬＶＡＬＴ＆ ＧＰ５ ＃ ＧＰ５＆ＶＣＬＫ ｌｐｍ＿ｆｆ＿ｃｏｍｐｏｎｅｎｔ２．ｄａｔａ０．．０ ＝ ＨＳＹＮＮ ＶＳＹＮＣ ＝ ｌｐｍ＿ｆｆ＿ｃｏｍｐｏｎｅｎｔ３．ｑ０．．０ ｌｐｍ＿ｆｆ＿ｃｏｍｐｏｎｅｎｔ３．ｃｌｏｃｋ ＝ ＦＶＡＬＴ＆ＳＴＲＯＢＴ＆ＬＶＡＬＴ＆ ＧＰ５ ＃ ＧＰ５＆ＶＣＬＫ ｌｐｍ＿ｆｆ＿ｃｏｍｐｏｎｅｎｔ３．ｄａｔａ０．．０ ＝ ＶＳＹＮＮ ＳＴＲＯＯ ＝ ＦＶＡＬＴ＆ＳＴＲＯＢＴ＆ＬＶＡＬＴ＆ＧＰ５ Ａ１９．．０ ＝ ｌｐｍ＿ｃｏｕｎｔｅｒ＿ｃｏｍｐｏｎｅｎｔ．ｑ１９．．０ ｌｐｍ＿ｃｏｕｎｔｅｒ＿ｃｏｍｐｏｎｅｎｔ．ａｃｌｒ ＝ ｓｃｌｒ ｌｐｍ＿ｃｏｕｎｔｅｒ＿ｃｏｍｐｏｎｅｎｔ．ｃｌｏｃｋ＝ＦＶＡＬＴ＆ＳＴＲＯＢＴ＆ＬＶＡＬＴ＆ ＧＰ５ ＃ ＧＰ５＆ＶＣＬＫ ／ＷＥ ＝ ＦＶＡＬＴ＆ＬＶＡＬＴ＆ＳＴＲＯＯ ／ＯＥ ＝ ＦＶＡＬＴ ＦＶＴＡ ＝ ＦＶＡＬＴ ／ＦＶＴＡ ＝ ＦＶＡＬＴ ＶＣＬＫ ＝ ｌｐｍ＿ｃｏｕｎｔｅｒ＿ｃｏｍｐｏｎｅｎｔ１．ｑ０．．０ ｌｐｍ＿ｃｏｕｎｔｅｒ＿ｃｏｍｐｏｎｅｎｔ１．ｃｌｏｃｋ ＝ ＶＶＣＬＫ ＶＶＣＬＫ ＝ ＣＬＫ ＆ ＧＰ５ ２ＶＣＬＫ ＝ ＶＶＣＬＫ Ｆ１ ＝ Ａ１９＆ＧＰ５ ＨＳＹＮＮ ＝Ａ５＆Ａ６＆Ａ７＆Ａ８＆Ａ９＆ＧＰ５ ＶＳＹＮＮ ＝Ａ１４＆Ａ１５＆Ａ１６＆Ａ１７＆Ａ１８＆ＧＰ５ ＥＮＤ ２．３ 多層高速印制電路板設計 筆者研制的圖像數(shù)據(jù)傳輸卡的印制板設計為四層板，除了頂層和低層外，單獨設計了電源和地層，這是基于ＰＣＩ總線板卡的基本要求。另外，由于卡上的數(shù)據(jù)、地址及控制信號多為高速信號，在進行印制板設計時，還必須注意以下幾點： %26;#183;ＰＣＩ橋引腳的走線長度限于１．５英寸，ＣＬＫ信號走線長度限于２．５%26;#177;０．１英寸，且只連接一個負載； %26;#183;板上的共享ＰＣＩ信號線的無負載特性阻抗（Ｚ０）應控制在６０～１００Ω； %26;#183;ＰＣＩ控制信號應考慮上拉電阻； %26;#183;每個電源引腳都要對地去耦合，處理開關電流的沖擊。一般跨接０．０１μＦ高頻去耦電容； %26;#183;采集卡應遵守引腳電容小于１０ｐＦ的限制； %26;#183;共享的ＰＣＩ信號在板上，只能帶一個負載。 在深入研究了數(shù)字ＣＣＤ相機接口要求的基礎上，按照以上的設計原理，自行研制成功基于ＰＣＩ總線的、適用于多相機同時曝光的圖像數(shù)據(jù)傳輸卡。該卡在機載多波段偏振成像系統(tǒng)原理樣機中成功地通過了調試。測試數(shù)據(jù)表明，圖像數(shù)據(jù)傳輸卡能夠滿足系統(tǒng)的設計要求。
關鍵詞：新型數(shù)字CCD相機及其圖像數(shù)據(jù)傳輸卡設計
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