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AD9850 |
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用AD9850激勵的鎖相環(huán)頻率合成器
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摘 要： 提出了一種DDS和PLL相結(jié)合的頻率合成方案，介紹了DDS芯片AD9850的基本工作原理、性能特點及引腳功能，給出了以AD9850作為參考信號源的鎖相環(huán)頻率合成器實例，并對該頻率合成器的硬件電路和軟件編程進行了簡要說明。
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| 以DDS(直接數(shù)字合成)激勵的PLL(鎖相環(huán))頻率合成器，是用DDS作為參考信號源，將DDS和PLL組合在一起的一種獨特的頻率合成器方案。它綜合了DDS和PLL頻率合成器的優(yōu)點，具有極高的頻率分辨率、極短的換頻時間和較好的噪聲性能，而且頻率范圍寬、控制靈活，是應用于雷達、通信等領(lǐng)域中的一種較為先進的頻率合成方案。其電路原理框圖如圖1所示。 | ||||||||||||||||||||||||||||||||||||||||||||||||
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我們在實際工作中，以美國AD公司生產(chǎn)的DDS芯片AD9850和MITEL公司的PLL芯片SP8858為核心，完成了一款高性能的DDS+PLL的頻率合成器的設(shè)計與試驗，并將其應用于一無線測量接收機中，收到了極好的效果。下面介紹AD9850的基本工作原理和引腳功能等，并給出頻率合成器實例的方案組成。
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| 1 AD9850的工作原理與引腳功能 1.1 基本工作原理 AD9850采用先進的DDS技術(shù)，在內(nèi)部集成了32位相位累加器、14 位正/余弦查詢表和高性能的10位D/A轉(zhuǎn)換器以及一個高速比較器，其原理框圖見圖2。 | ||||||||||||||||||||||||||||||||||||||||||||||||
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| 它通過并口或串口寫入的頻率控制字來設(shè)定相位累加器的步長大小，相位累加器輸出的數(shù)字相位通過查找正/余弦查詢表得到所需頻率信號的采樣值，然后通過D/A變換，輸出所需頻率的正弦波信號。還可以通過高速比較器將該正弦波信號轉(zhuǎn)換成方波，作為時鐘信號輸出。 輸出信號的頻率FDDS由下式確定： FDDS＝△f·FCLK/232(1) 式中，△f為32位頻率控制字的值，F(xiàn)CLK為工作時鐘。 1.2 控制方式 AD9850內(nèi)部的5個8位寄存器構(gòu)成一個40位的數(shù)據(jù)寄存器，儲存來自外部數(shù)據(jù)總線的數(shù)據(jù)和控制字，其中32位為頻率控制字、5位為相位調(diào)制字、1位是電源休眠(power down)功能控制，另2位儲存工廠保留碼(用戶編程時，應將其設(shè)定為"00")。寄存器可通過并行或串行方式裝載。 并行方式是在使能信號FQ_UD和寫脈沖WCLK的控制下，通過8位數(shù)據(jù)總線D0～D7分五次來完成全部40位數(shù)據(jù)的輸入，其工作時序圖見圖3。 | ||||||||||||||||||||||||||||||||||||||||||||||||
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| 在FQ_UD的上升沿，40位數(shù)據(jù)從輸入寄存器打入數(shù)據(jù)寄存器，同時將地址指針復位到第一個輸入寄存器。隨后，在WCLK的上升沿寫入第一組8位數(shù)，并把指針指向下一個輸入寄存器。連續(xù)五次裝載以后，WCLK的上升沿無效，直到復位信號Reset有效或者FQ_UD的上升沿再次來到。 串行輸入方式如圖4所示，在WCLK的上升沿，40位數(shù)據(jù)由低位到高位依次從引腳25(D7)移入到輸入寄存器，并在FQ_UD的脈沖作用下，一次性打入到數(shù)據(jù)寄存器，以更新芯片的輸出頻率(或相位)。 | ||||||||||||||||||||||||||||||||||||||||||||||||
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| 1.3 主要性能 (1)單電源工作：+3.3V或+5V。 (2)接口簡單，可用8位并行口或串行口直接裝載頻率和相位調(diào)制數(shù)據(jù)。 (3)片內(nèi)有高性能D/A轉(zhuǎn)換器和高速比較器，可輸出正弦波和方波。 (4)最高工作時鐘125MHz，32位頻率控制字保證在125MHz的工作時鐘下頻率分辨率達0.0291Hz。 (5)5位調(diào)相控制字，可實現(xiàn)相位調(diào)制功能。 (6)頻率轉(zhuǎn)換速率極快，可達2.3×107次/秒。 (7)低功耗：在125MHz時鐘頻率、+5V電源工作時，功耗為380mW；110MHz時鐘、+3.3v工作時，功耗為155mW。 (8)工作溫度范圍寬：-40℃～+85℃。 1.4 引腳功能 AD9850為28腳緊縮型小外形封裝(SSOP)，其管腳排列見圖5，引腳功能如表1所示。 | ||||||||||||||||||||||||||||||||||||||||||||||||
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| 2 用AD9850作參考信號源的PLL頻率合成器實例 2.1 硬件設(shè)計 本頻合器是一個頻率范圍為1.6GHz～2.9GHz的頻率合成器，其硬件組成框圖如圖6所示。 | ||||||||||||||||||||||||||||||||||||||||||||||||
| AD9850工作在100MHz參考時鐘下，產(chǎn)生16MHz左右的正弦波信號，其D/A轉(zhuǎn)換器的輸出經(jīng)過一個中心頻率為16MHz、帶寬為4MHz的帶通濾波器之后，給PLL芯片SP8858提供鑒相標頻。SP8858是一種高性能的脈沖吞除式數(shù)字鎖相環(huán)頻率合成器芯片，其工作頻率高達1.5GHz，片內(nèi)PD采用線性的數(shù)字鑒頻-鑒相器，最高鑒相頻率可達5MHz；內(nèi)部還包括÷16/17(或÷8/9)的雙模前置分頻器，兩個15位的程序分頻器，一個4位的吞脈沖計數(shù)器和一個13位的參考分頻器。兩個程序分頻器數(shù)據(jù)緩沖器可輪流工作，有助于減少頻合器的換頻時間。外部的微處理器可通過對片內(nèi)的三總線串行數(shù)據(jù)接口進行操作，來控制各分頻器的狀態(tài)和數(shù)據(jù)刷新。 AD9850和SP8858的置數(shù)由數(shù)字信號處理芯片TMS320C32的串口控制。在我們設(shè)計的無線測量接收機中，整個系統(tǒng)的控制和數(shù)字信號的處理由TMS320C32完成。為了簡化系統(tǒng)，將TMS320C32的串口用于頻率合成器的置數(shù)和頻率刷新。 環(huán)路濾波器是由低噪聲運放LT1028構(gòu)成的有源二階低通濾波器，VCO由HE404B和HE486B兩只低噪聲壓控振蕩器分段組成，以覆蓋1.6GHz～2.9GHz的頻率范圍。VCO的輸出信號分成兩路，一路經(jīng)放大和4分頻后送入SP8858進行程序分頻、鑒相；另一路經(jīng)由RFIC芯片ERA-5放大后作為本振信號輸出。 2.2 軟件編程 軟件編程比較簡單，主要是根據(jù)AD9850和SP8858的控制字方式，由TMS320C32通過串口分別將相應的控制字裝載到兩只芯片中去，以產(chǎn)生需要信號的頻率。 在本例中，SP8858主要控制信號頻率的粗調(diào)，其步進量△f為4MHz；AD9850實現(xiàn)信號頻率的細調(diào)，控制其輸出頻率在16MHz附近變化，步進量接近1Hz。 SP8858的編程規(guī)則可參考文獻2。從系統(tǒng)的總體設(shè)計考慮，為了與SP8858的串行送數(shù)方式一致，AD9850的數(shù)據(jù)輸入方式也采用串行方式(此時，芯片的2腳應接地，3腳和4腳接VDD，數(shù)據(jù)從25腳輸入)，串行裝載時40位數(shù)據(jù)的功能見表2，編程時應將"W32 W33 W34"置為"000"。 | ||||||||||||||||||||||||||||||||||||||||||||||||
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表2 串行裝載時40位數(shù)據(jù)的功能 | ||||||||||||||||||||||||||||||||||||||||||||||||
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2.3 測試結(jié)果
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| 參考文獻 1 CMOS 125MHz Complete DDS Synthesizer Data sheet． REV E-5/99 2 SP8858 1.5GHz Professional Synthesizer Data sheet． MITEL 1998 |
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