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CDCD5704 的貨源和報(bào)價(jià) CDCD5704 的相關(guān)技術(shù)信息

其他型號(hào)

德州儀器CDCD5704時(shí)鐘發(fā)生器用于存儲(chǔ)器時(shí)鐘

    TI(德州儀器)日前發(fā)布的CDCD5704時(shí)鐘發(fā)生器可借助帶或不帶擴(kuò)頻調(diào)制功能的參考時(shí)鐘輸入，提供支持XDR存儲(chǔ)器子系統(tǒng)與Redwood邏輯接口所必需的時(shí)鐘信號(hào)。CDCD5704采用28引腳TSSOP封裝，其中包含4個(gè)差動(dòng)時(shí)鐘輸出，能夠?yàn)楦鞣N高性能接口應(yīng)用提供現(xiàn)成的解決方案。

    CDCD5704的主要組件包括一個(gè)鎖相環(huán)、一個(gè)旁路多路復(fù)用器以及4個(gè)差動(dòng)輸出緩沖器(CLK0至CLK3)。EN引腳輸入端的邏輯低電平可禁用所有4個(gè)輸出。當(dāng)EN為高電平且串行接口寄存器(RegA-RegD)的值為1時(shí)，就會(huì)啟用輸出。

    PLL可接收參考時(shí)鐘輸入信號(hào)REFCLK，并在頻率等于輸入頻率與乘法系數(shù)之積的條件下輸出時(shí)鐘信號(hào)。將PLL輸出時(shí)鐘信號(hào)饋送至差動(dòng)輸出緩沖器，以驅(qū)動(dòng)啟用的時(shí)鐘。另外將禁用的輸出設(shè)置為高阻抗。旁路模式可以繞過(guò)PLL，將輸入時(shí)鐘REFCLK路由至差動(dòng)輸出緩沖器。

    為了確保CDCD5704時(shí)鐘發(fā)生器始終正確運(yùn)行，一旦時(shí)鐘輸入低于10MHz，器件就會(huì)關(guān)閉PLL，并將輸出置于高阻抗?fàn)顟B(tài)。如果電源電壓VDD小于VPUC，則復(fù)位所有邏輯柵極、斷開(kāi)PLL電源，同時(shí)將輸出置于高阻抗?fàn)顟B(tài)。器件只有在滿足這些要求后才能開(kāi)始工作。

    由于CDCD5704采用PLL電路，因此它要求一段穩(wěn)定時(shí)間，以實(shí)現(xiàn)PLL的鎖相位(phase-lock)功能。使用外部參考時(shí)鐘時(shí)，在開(kāi)始進(jìn)入穩(wěn)定時(shí)間之前，該信號(hào)必須處于固定頻率與固定相位狀態(tài)。

    該器件可在2.5V單電源電壓下工作。CDCD5704器件的工作溫度范圍為0℃至70℃。